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题名/责任者:

AMD FPGA设计优化宝典:面向Vivado/System Verilog/高亚军编著

出版发行项:

北京:电子工业出版社,2023.07

ISBN及定价:

978-7-121-45725-8/CNY125.00

载体形态项:

432页:图;26cm

个人责任者:

高亚军 编著

学科主题:

可编程序逻辑阵列-系统设计

中图法分类号:

TP332.1

一般附注:

EDA精品智汇馆

提要文摘附注:

本书以Xilinx公司7系列FPGA、UltraScale/UltraScale+和Versal ACAP内部架构为基础，介绍了与之匹配的RTL代码风格(采用Sytem Verilog语言)和基于Vivado的设计分析方法。全书共10章，包括时钟网络、组合逻辑、触发器、移位寄存器、存储器、乘加运算单元和状态机等的代码风格与优化方法，以及扇出和布线拥塞的优化方法。

使用对象附注:

本书可供电子工程领域内的本科高年级学生和研究生学习参考，也可供FPGA工程师和自学者参考使用

电子资源:

http://www.cxstar.com/Book/Detail?pinst=P6u77RH0me5oQF0l5w3&ruid=2c8854300005f8XXXX

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